对偶数分频，只需设计一个计数器进行计数，待计数至分频数的二分之一时，使分频后的时钟电平翻转即可;奇数分频较为复杂，因为计数器不能对非整数进行计数，需使用一定的算法进行处理。这里对奇数分频模块进行功能仿真后的波形见图2。

　　ANF信号每隔20ms发送一次，每次发送脉宽为10个时钟周期。ANF信号的产生可以分成两部分实现：首先产生间隔20ms的脉冲信号，然后把此脉冲信号的宽度变成10个时钟周期。

　　串行数据的发送与接收
　　产生串行数据时，根据通信协议的要求，测速定位单元每隔20ms应串行移出72bits数据。如果每个发送时钟周期移出一位，则需要72个时钟周期才能全部移出，因此门控信号也需要保持72个时钟周期的宽度。

　　接收串行数据时，同步串行接收一帧(72bits)数据与异步串行接收是不同的。由于收发时钟不是异步的，因此不能以判断在空闲态以后出现的第一个低电平作为一帧的开始，而是以门控信号(UEF)的上升沿作为一帧数据到来的判断。为了避免数据传输过程中毛刺的影响，我们仍以波特率时钟的16倍进行接收，即每隔16个波特率时钟周期采样一次，因此，每个数据将在传输的每一位的中点处被采样。

　　串行数据发送与接收的仿真时序
　　收发器与控制器之间的数据交换
基于RS-485的同步通信时序是用FPGA作为通信收发器来模拟的，但是通信数据最终是与系统的CPU进行数据交换的。在该通信方式的设计中，通信双方均采用TMS320F2812作为通信控制器。FPGA与DSP的数据交换必须满足一定的时序，才能保证测速定位单元向车载无线电控制单元实时地传输位置及速度信号。本系统中，DSP控制器采用C语言进行软件设计。

　　测速定位单元侧DSP与FPGA的数据交换
　　TMS320F2812的外部存储器XINTF可供选择的外部地址空间有XINTF0、XINTF2及XINTF6。其中XINTF0使用 XZCS0AND1作为片选信号，外部存储器扩展空间为8K;XINTF2与XINTF6分别使用XZCS2、XZCS6AND7作为片选信号，外部存储器扩展空间均为0.5M。测速定位单元在发送位置速度信息时，通过DSP的数据线传输到FPGA，DSP根据相应的外部存储器片选信号找出对应的地址，在从底层传感器得到一个新的定位数据后写入该地址。相对应的硬件连接框图见图4。

　　根据协议要求，定位信息每次发送时包括5个字节的用户数据和2个字节的CRC校验，因此，16bits数据线至少需要连续发送四次，才能将底层的定位信息完整地传送到FPGA。